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TMS320VC5509AZAYR定點數字信號處理器 (DSP) 基于TMS320C55x DSP代CPU處理器內核。C55x? DSP架構通過提高并行性和專注于降低功耗來實現高性能和低功耗。

TMS320C55x CPU提供兩個乘法累加（MAC）單元，每個單元均可在單個周期內實現17位乘以17位乘法。

產品：TMS320VC5509AZAYR

核心：C55x

時鐘速率：200MHz

封裝：NFBGA-179

特性：

高性能、低功耗、定點TMS320C55?數字信號處理器

指令周期時間：9.26ns、6.95ns、5ns

時鐘速率：108MHz、144MHz、200MHz

每個周期執(zhí)行一條/兩條指令

雙乘法器[高達每秒4億次乘加運算 (MMACS)]

兩個算術/邏輯單元(ALU)

三條內部數據/操作數讀取總線和兩條內部數據/操作數寫入總線

128K × 16位片上RAM，包括

64K字節(jié)雙存取RAM (DARAM)，8塊4K×16位

192K字節(jié)單存取RAM (SARAM)，24塊4K×16位

64Kb一次等待狀態(tài)片上ROM（32K × 16位）

8M × 16位最大可尋址外部存儲器空間（同步DRAM）

16位外部并行總線存儲器，支持任一

外部存儲器接口 (EMIF)，具有GPIO功能并無縫連接

異步靜態(tài)RAM(SRAM)

異步EPROM

同步DRAM (SDRAM)

16位并行增強型主機端口接口 (EHPI)，具有GPIO功能

可編程低功耗控制六個器件功能域

基于片上掃描的仿真邏輯

片上外設

兩個20位定時器

看門狗定時器

6通道直接內存訪問 (DMA) 控制器

三個串行端口，支持以下組合：

多達3個多通道緩沖式串行端口（McBSP）

多達2個多媒體/安全數字卡接口

可編程鎖相環(huán) (PLL) 時鐘發(fā)生器

七個（LQFP）或八個（BGA）通用I/O（GPIO）引腳和一個通用輸出引腳（XF）

USB全速（12Mbps）從端口，支持批量、中斷和同步傳輸

內部集成電路（I2C）多主從接口

實時時鐘（RTC），帶晶體輸入、獨立時鐘域和獨立電源

4通道（BGA）或2通道（LQFP）10位逐次逼近模數轉換器

IEEE Std 1149.1 (JTAG) 邊界掃描邏輯

封裝

144引腳薄型四方扁平 (LQFP) 封裝（PGE后綴）

179引腳MicroStar BGA?（球柵陣列）（GHH和ZHH后綴）

179端子無引線MicroStar BGA?（球柵陣列）（ZHH后綴）

1.2V內核 (108MHz)，2.7V至3.6V I/O

1.35V內核 (144MHz)，2.7V至3.6V I/O

1.6V內核 (200MHz)，2.7V至3.6V I/O

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